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전홍신 (Hong-Shin Jun)

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대한전자공학회
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주요 연구분야

  • 공학 > 전자/정보통신공학

저자의 연구 키워드

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  • 논문수13
  • 발행기간1990 ~ 1995
  • 이용수106
  • 피인용수0

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  • 피인용 논문 제목
    • 피인용 논문 저자
게시판 목록
논문명 저널명 발행연도 이용수 피인용수
Automatic synthesis of dynamically configured pipelines supporting variable data initiation intervals 대한전자공학회 학술대회 1995 0 0
SODAS-DSP DSP 하드웨어 자동설계 시스템 ( SODAS-DSP : An Automatic Synthesis System for DSP Hardwares ) 대한전자공학회 학술대회 1995 3 0
Automatic synthesis of dynamically configured pipelines supporting variable data initiation intervals 대한전자공학회 토론회 1995 1 0
Multichip 아키텍춰 합성 알고리듬 설계 ( The design of a Synthesis Algorithm for Multichip Architectures ) 전자공학회논문지-A 1994 11 0
가변 데이터 입력 간격을 지원하는 파이프라인 구조의 합성 ( Synthesis of Pipeline Structures with Variable Data Initiation Intervals ) 전자공학회논문지-A 1994 22 0
서강 실리콘 컴파일러 시스템의 설계 프레임워크 ( Design Framework of the Sogang Silicon Compiler System ) CAD 및 VLSI 설계연구회지 1994 15 0
디지탈 신호처리를 위한 파이프라인 데이타패스 합성 시스템의 설계 ( Design of a Pipelined Datapath Synthesis System for Digital Signal Processing ) 전자공학회논문지-A 1993 15 0
가변 데이터 입력 간격을 지원하는 파이프라인 구조 합성 시스템의 설계 ( Design of A High Level Synthesis System for Pipeline Structure with Variable Data Initiation Interval ) 대한전자공학회 학술대회 1993 2 0
상위수준 합성 전자공학회지 1992 15 0
파이프라인 데이타패스 합성 시스템의 설계 ( Design of Pipelined Datapath Synthesis System ) 대한전자공학회 학술대회 1992 1 0
서강 실리콘 컴파일러의 High Level Sythesis 시스템 설계 ( Design of High Level Synthesis System in Sogang Silicon Compiler ) 전자공학회논문지-A 1991 19 0
SHSS-V : VHDL 상위 수준 합성 시스템 ( SHSS-V : High-Level Synthesis System for VHDL ) 대한전자공학회 학술대회 1991 1 0
데이타패스 합성을 위한 효율적 알고리즘 ( An Efficient Algorithm for Datapath Synthesis ) 대한전자공학회 학술대회 1990 1 0