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논문 기본 정보
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- 학술저널
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- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.7 No.4
- 발행연도
- 2007.12
- 수록면
- 281 - 286 (6page)
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In this paper, sub-circuits for 24 ㎓ phase locked loops(PLLs) using 0.5 ㎛ SiGe HBT are presented. They are 24 Ghz voltage controlled oscillator(VCO), 24 ㎓ to 12 GHz regenerative frequency divider(RFD) and 12 ㎓ to 1.5 ㎓ static frequency divider. 0.5 ㎛ SiGe HBT technology, which offers transistors with 90 ㎓ fMAX and 3 aluminum metal layers, is employed. The 24 ㎓ VCO employed series feedback topology for high frequency operation and showed -1.8 to -3.8 ㏈m output power within tuning range from 23.2 ㎓ to 26 ㎓. The 24 ㎓ to 12 ㎓ RFD, based on Gilbert cell mixer, showed 1.2 ㎓ bandwidth around 24 ㎓ under 2 ㏈m input and consumes 44 ㎃ from 3 V power supply including I/O buffers for measurement. ECL based static divider operated up to 12.5 ㎓ while generating divide by 8 output frequency. The static divider drains 22 ㎃ from 3 V power supply.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. CIRCUIT DESIGN & MEASUREMENT
Ⅲ. CONCLUSIONS
REFERENCES
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