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저자정보
Y. Choi (고려대학교) E.-K. Hong (고려대학교) G.-H. Lee (고려대학교) Y.-L. Shen (고려대학교) T.-K. Kim (고려대학교) H.-G. Kim (에이디칩스) H.-C. Oh (고려대학교)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2008
발행연도
2008.7
수록면
1,633 - 1,636 (4page)

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This paper presents a prototype hardware accelerator for two-dimensional vector graphics applications based on the OpenVG standard. Since our design mainly targets embedded applications, we focus on efficient uses of limited resources, especially the memory bandwidth. The designed accelerator can process images of 640x240 pixels with moderate complexity at the rate of 30 frames per second. Our current design costs approximately .40 million equivalent gates when it is implemented using a 0.18um CMOS standard cell library.

목차

Abstract
1. Introduction
2. The Accelerator
3. Evaluation
4. Conclusion
Acknowledgement
References

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