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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2013.12
- 수록면
- 418 - 427 (10page)
이용수
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본 논문에서는 H.264/AVC 비디오 코덱용 디블록킹 필터의 병렬 알고리즘을 제안한다. 디블록킹 필터는 BS(boundary strength)에 따라 다른 필터 연산을 수행하며, 각 필터 연산은 다양한 조건 연산을 필요로 한다. 또한 각 경계면의 연산 순서가 정해져 있기 때문에 병렬 처리가 쉽지 않다. 본 논문에서 제안하는 디블록킹 필터 알고리즘은 최근에 소개된 1-D CGRA (coarse grained reconfigurable architecture)인 PRAGRAM (pipelined reconfigurable arrays with assistant manager groups)에서 처리된다. 디블록킹 필터 연산은 PRAGRAM의 단방향 파이프라인 PE 배열 구조를 이용하여 각 필터 연산을 고속으로 수행하고, dynamic reconfiguration 및 conditional reconfiguration을 이용하여 필터 선택과 조건 연산을 효율적으로 처리한다. 디블록킹 필터의 병렬 알고리즘은 매크로블록 당 225 사이클을 소요한다. 이는 동작주파수 150 MHz에서 full HD급 영상을 처리할 수 있는 성능이다.
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1. [기타자료] - Joint Video Team of ITU-T and ISO/IEC JTC / 2003 / Draft ITU-T Recommendation and Final Draft International Standard of Joint Video Specification (ITU-T Rec. H.264 | ISO/IEC 14496-10 AVC) / Joint Video Team (JVT) of ISO/IEC MPEG and ITU-T VCEG, JVT-G050
2. [학술대회논문] - Hartenstein, R. / 2001 / A decade of reconfigurable computing: a visionary retrospective / Design, Automation and Test in Europe, 2001. Conference and Exhibition 2001. Proceedings : 642 ~ 649
3. [학술지(정기간행물)] - Singh, H. / 2000 / MorphoSys : an integrated reconfigurable system for data-parallel and computation-intensive applications / Computers, IEEE Transactions on 49 (5) : 465 ~ 481
4. [학술대회논문] - Chalamalasetti, S.R. / 2009 / MORA - An Architecture and Programming Model for a Resource Efficient Coarse Grained Reconfigurable Processor / Adaptive Hardware and Systems, 2009. AHS 2009. NASA/ESA Conference on : 389 ~ 396
5. [학술지(정기간행물)] - Purohit, S. / / Throughput/Resource-Efficient Reconfigurable Processor for Multimedia Applications / Very Large Scale Integration (VLSI) Systems, IEEE Transactions on (99) : 1 ~
2. [학술대회논문] - Hartenstein, R. / 2001 / A decade of reconfigurable computing: a visionary retrospective / Design, Automation and Test in Europe, 2001. Conference and Exhibition 2001. Proceedings : 642 ~ 649
3. [학술지(정기간행물)] - Singh, H. / 2000 / MorphoSys : an integrated reconfigurable system for data-parallel and computation-intensive applications / Computers, IEEE Transactions on 49 (5) : 465 ~ 481
4. [학술대회논문] - Chalamalasetti, S.R. / 2009 / MORA - An Architecture and Programming Model for a Resource Efficient Coarse Grained Reconfigurable Processor / Adaptive Hardware and Systems, 2009. AHS 2009. NASA/ESA Conference on : 389 ~ 396
5. [학술지(정기간행물)] - Purohit, S. / / Throughput/Resource-Efficient Reconfigurable Processor for Multimedia Applications / Very Large Scale Integration (VLSI) Systems, IEEE Transactions on (99) : 1 ~
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