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논문 기본 정보

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학술저널
저자정보
이승우 (엘디티) 이민웅 (전북대학교) 김하철 (해군사관학교) 조성익 (전북대학교)
저널정보
대한전기학회 전기학회논문지 전기학회논문지 제67권 제4호
발행연도
2018.4
수록면
538 - 542 (5page)

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In order to generate a clock source with low cost and high performance in system on chip(SoC), a relaxation oscillator with stable output characteristics according to PVT(process, voltage and temperature) fluctuation require a low area and a low power. In this paper, we propose a solution to reduce the current loss caused by parasitic components in the conventional relaxation oscillator. Since the slew rate of the bias current and the capacitor are adjusted to be the same through the proposed solution, a relaxation oscillator with low area characteristics is designed for the same clock source frequency implementation. The proposed circuit is designed using the TSMC CMOS 0.18㎛ process. The Simulation results show that the relaxation oscillator using the proposed solution can prevent the current loss of about 279㎂ and reduce the total chip area by 20.8% compared with the conventional oscillator in the clock source frequency of 96㎒.

목차

Abstract
1. 서론
2. 본론
3. 결론
References

참고문헌 (10)

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