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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2023.11
- 수록면
- 111 - 115 (5page)
- DOI
- 10.5573/ieie.2023.60.11.111
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기존의 위상 압축 플립플롭(TCFF)은 내부 노드의 데이터 전환을 줄이고 트랜지스터 수를 최소화하여 높은 에너지 효율을 달성하지만, NTV(Near Threshold Voltage) 수준에서 동작할 경우 기능 장애로 이어질 수 있는 동작 실패 case가 존재한다. 이러한 문제를 해결하여 제시된 플립플롭(SCTCFF)은 전력 손실 없이 0.3V까지 동작할 수 있습니다. 65nm CMOS 공정을 사용하여 FF의 테스트 회로에서 SCTCFF는 1V, 10%/20%의 activitiy ratio에서 TGFF에 비해 44.4%/39.0%의 전력을 절약하는 것으로 나타났습니다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 설계된 플립플롭 구조
Ⅲ. 시뮬레이션 결과
Ⅳ. 결론
REFERENCES
참고문헌 (3)
참고문헌 신청
L. Atzori, A. Iera, and G. Morabito, “The Internet of Things: A survey,” Comput. Netw., vol. 54, no. 15, pp. 2787–2805, Oct. 2010.
Y. Kim et al., “A static contention-free single-phase-clocked 24T flipflop in 45 nm for low-power applications,” in IEEE Int. Solid-State Circuits Conf. (ISSCC) Dig. Tech. Papers, Feb. 2014, pp. 466–467.
N. Kawai et al., “A fully static topologically-compressed 21-transistor flip-flop with 75% power saving,” IEEE J. Solid-State Circuits, vol. 49, no. 11, pp. 2526–2533, Nov. 2014.
Y. Kim et al., “A static contention-free single-phase-clocked 24T flipflop in 45 nm for low-power applications,” in IEEE Int. Solid-State Circuits Conf. (ISSCC) Dig. Tech. Papers, Feb. 2014, pp. 466–467.
N. Kawai et al., “A fully static topologically-compressed 21-transistor flip-flop with 75% power saving,” IEEE J. Solid-State Circuits, vol. 49, no. 11, pp. 2526–2533, Nov. 2014.
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