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대한전자공학회 JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
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    This paper describes the efficient snooping cache controller design for the tightly coupled multiprocessor systems. The control unit controls a direct mapped virtual cache[1] and implements the cache coherence protocol to maintain the data consistency between caches and main memory in the multiprocessor systems. The controller is designed by 7 FSMs(Finite State Machines): 4 FSMs for a cache controller and 3 FSMs for a snooping controller. The function of the control logic is verified through the HDL(hardware description language) modeling and simulation. The simulation results show that the cache consistency protocol implemented maintains the data consistency through the system bus in the multiprocessor systems consisting of RISC CPU. The cache controller is being implemented in a 0.8μm double-layer metal CMOS technology, and will be implemented in a single chip with MMU(Memory Management Unit).

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