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대한전자공학회 ICVC : International Conference on VLSI and CAD ICVC : International Conference on VLSI and CAD 제5권
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    This paper proposed a new delay model for large digital CMOS circuits to predict the delay time during the gate-level design. As the modeling method, the CMOS inverter which is the simplest gate was used to find the model first, and then it was extended to other CMOS gates The proposed model is pure calculational one including the characteristics of MOSFETs. Thus, the modeling process included ... 전체 초록 보기

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      UCI(KEPA) : I410-ECN-0101-2009-569-013211979