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대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : International Technical Conference on Circuits Systems, Computers and Communications 제2권
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    This paper presents a 32×32 partitioned multiplier. It is capable of one 32×32 or 16×32, two 16×16 or 8×16, four 8×8 multiplications with maximum hardware efficiency. It is based on radix-4 modified booth algorithm and composed of a common encoder and reconfigurable partial product compression tree.

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