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대한전자공학회 JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
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    A S/T transciever conforming to CCITT I.430 recommendation is used in ISDN to transmit bidirectionally two 64kb/s B-channels and a 16kb/s D-channel (2B+D) between one network terminal and up to 8 terminal equipments. Since the S/T transceiver circuit can be configured in the master(NT) or slave(TE) mode, it can be used at either end of the S-interface. This paper presents an analog front end of the S/T transceiver. VLSI chip, the S/T transceiver. The VLSI concept presented in this paper is based on the EI(ETRI ISDN) architecture which is used on analog and digital line cards in NT, TE, and PABX applications. The first part of this paper outlines the general functions of the S/T transceiver. Next, the features and circuits of S-interface analog front end are listed. The chip implementation is then briefly described and finally, the conclusion is described.

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