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대한전자공학회 ICVC : International Conference on VLSI and CAD ICVC : International Conference on VLSI and CAD 제2권
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    A monolithic 3-channel BiCMOS DAC (Digital to Analog Converter) based on the R-2R ladder and segmentation is presented. To reduce power consumption, mixed bipolar and CMOS circuits were used. In the digital part of this DAC, CMOS circuits were used for power reduction. To drive bipolar current switches, a new BiCMOS level translator was invented for minimization of glitch. A voltage reference was designed and a temperature and supply independent biasing was realized. To analyze the effect of the voltage sensitivity of resistor, a simple model of the ladder resistor resistance was made. The 3-channel 8-bit DAC was fabricated by 1.5µm BiCMOS process, and operates up to 80MHz and shows 7.5 bit resolution at 10MHz without trimming. Its linearity error is 0.33 LSB, and the differential non-linearity is 0.12 LSB. This chip consumes about 200mW. The total chip size is 2.21×3.27 mm².

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