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논문 기본 정보
- 저자정보
초록·키워드
This paper proposes a multi-phase ring oscillator based fractional-N phase locked loop (FNPLL) frequency synthesizer using phase interpolator for high-speed serial link. This paper aims to reduce quantization noise by employing subinteger divider, extending PLL bandwidth. Fabricated in 8 nm CMOS process, the proposed FNPLL operates over wide frequency range of 0.1-3 GHz. The proposed FNPLL achieves 1.49 ps rms integrated jitter at 3 GHz output. The proposed FNPLL achieves wide BW up to 2 MHz using a 25 MHz reference clock.
본문·목차
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