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논문 기본 정보
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초록·키워드
최근 SoC (System on Chip) 및 SiP (System in Package) 기술의 발전으로 대량의 데이터를 보다 신속하게 처리하기 위한 인터페이스가 요구되고 있다. 대량의 데이터는 다양한 전송 방법을 가지고 있는데, 가장 고전적인 방법은 병렬 데이터 전송 방법이다. 하지만 IC의 고집적화에 따라, 병렬 데이터 전송 시스템은 누화(cross-talk), 클록 왜곡(clock-skew) 등 문제점이 다수 발생한다. 직렬화기(Serializer)는 이를 해결하기 위한 시스템 중 하나이며 가장 기본적인 직렬화기는 2비트 직렬화기를 계단식으로 연결하여 구현한다. 이러한 변환방법은 비트 수가 늘어날수록 지연시간이 늘어나는 치명적인 단점이 존재한다. 본 논문에서는 직렬화기의 기존 계단식 배치 설계 방식에서 병렬식 배치 설계 방식을 통한 문제 해결 및 고성능 직렬화기를 제안한다.
본문·목차
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UCI(KEPA) : I410-ECN-0101-2019-004-000181469
