3D 적층 공정의 큰 메모리 대역폭 활용을 위한 스트림 버퍼 기반 적응적 선인출 기법

Q: 이 논문에서 정의한 3차원 적층 공정이란 무엇인가?

TSV와 같은 기술을 통해 칩을 3차원적으로 집적함으로써 기존의 2D 구조보다 더 빠르고 큰 메모리 대역폭을 제공하는 기술을 의미한다. 이는 실리콘 웨이퍼를 관통하는 전극을 통해 칩 간의 효율적인 전기적 연결을 가능하게 하는 집적 방식이다.

Q: 3차원 적층 공정 기반의 적응적 선인출 기법은 메모리 성능에 어떤 영향을 미치는가?

연구 결과, 제안된 기법은 일반적인 2D 구조 대비 평균 65%, 기존 L2 캐시 기반 3D 구조 대비 평균 21%의 성능 향상을 보였다. 특히 순차적 접근성이 강한 응용 프로그램일수록 기존 스트림 버퍼보다 최대 20%까지 더 높은 성능 향상을 달성한다.

임홍열; 이병민; 박기호

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자료유형: 학술대회자료

저자정보: 임홍열 (세종대학교) 이병민 (세종대학교) 박기호 (세종대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2011년도 대한전자공학회 추계종합학술대회

발행연도: 2011.11

수록면: 166 - 169 (4page)

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Three-dimensional (3-D) integration technology which recently becomes more popular provides several innovative potentials for the performance and/or power efficiency improvement. This paper analyzes the effect of the high memory bandwidth provided by 3-D integration technology and presents an adaptive prefetching mechanism having a stream buffers. Performance evaluation results show that the proposed adaptive prefetching mechanism can achieve performance improvement over the conventional stream buffer scheme about 9 ? 20% on average.

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