고속 플래시 AD 변환기를 위한 Successive Selection Encoder의 Logical Effort에 의한 설계

이기준; Kyusun Choi; 김병수

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자료유형: 학술저널

저자정보: 이기준 Kyusun Choi 김병수

저널정보: 대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제4호

발행연도: 2005.4

수록면: 37 - 44 (8page)

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고속 flash ADC를 위하여, Successive Selection Encoder (SSE)라고 명명된 새로운 형태의 TC-to-BC encoder를 제안한다. 기존의 fat tree encoder가 OR 논리에 의하여 동작되는데 반하여, 제안된 SSE는 MUX 논리에 의하여 입력 TC 신호 들 중에서 직접 출력 BC 신호를 선택한다. 제안한 SSE의 구현을 위하여, Logical Effort 방법과 Hynix 0.25um 제조 공정에 의한 실험을 바탕으로 효율적인 SSE의 구현 구조를 정하였다. 이론적 모델과 실험 결과를 보면, SSE가 fat tree encoder에 비하여 (1) one-out-of-n 신호를 발생할 필요가 없고, (2) 사용되는 게이트 수는 약 1/3로 감소하며, (3) 동작속도는 2배 이상 빨라진다. 제안된 SSE는 고속 ADC에 적합한 TC-to-BC encoder로 사용 될 수 있다.

참고문헌 (12)

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[학술지(정기간행물)] - Daegyu Lee / 2002. / Fat Tree Encoder Design for Ultra-High Speed Flash A/D converters

[학술지(정기간행물)] - Jincheol Yoo, Kyusun Choi, / 2003. / Quantum Voltage Comparator for 0.07 um CMOS Flash A/D Converters : 280 ~ 281

[학술지(정기간행물)] - 이승훈 / 1999. / CMOS 아날로그/혼성모드 집적시스템 설계＂ IDEC 교재개발시리즈 16

[학술지(정기간행물)] - R. Kanan / 1999. / A 640mW High Accuracy 8-bit 1GHz Flash ADC Encoder : 420 ~ 423

[학술지(정기간행물)] - P. Xiao / 1997. / A 4b 8G Sample/s AD Converter in SiGe Bipolar Technology : 124 ~ 125

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