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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2009.11
- 수록면
- 48 - 55 (8page)
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본 논문에서는 차세대 100-Gb/s급 광통신 시스템을 위한 3-병렬 Reed-Solomon (RS) 디코더 기반의 고속 Forward Error Correction (FEC) 구조를 제안한다. 제안된 16채널 RS기반 FEC 구조는 4개의 신드롬 계산 블록이 1개의 Key Equation Solver (KES) 블록을 공유하는 3-병렬 4채널 RS 기반 FEC 구조 4개로 구성되어 있다. 제안하는 100-Gb/s RS 기반 FEC는 1.2V의 공급전압의 0.13㎛ CMOS 공정을 이용하여 구현하였다. 구현 결과 제안된 RS기반 FEC 구조는 300㎒의 동작 주파수에서 115-Gb/s 의 데이터 처리율을 가지며, 기존의 RS 기반 FEC 구조에 비해 높은 데이터 처리율과 낮은 하드웨어 복잡도를 보여주고 있다.
목차
요약
Abstract
Ⅰ. INTRODUCTION
Ⅱ. THREE-PARALLEL REED-SOLOMON ENCODER
Ⅲ. THREE-PARALLEL REED-SOLOMON DECODER
Ⅳ. 25 AND 100-GB/S RS-FEC ARCHITECTURE WITH THREE-PARALLEL PROCESSING
Ⅴ. RESULTS AND COMPARISON
Ⅵ. Conclusions
REFERENCES
저자소개
참고문헌 (9)
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1. [기타자료] - / / IEEE P802.3ba 4IEEE P802.3ba 40Gb/s and 100Gb/s Ethrnet Task Force
2. [학술지(정기간행물)] - ITU-T G.709/Y.133 / 2003 / Interfaces for the Optical Transport Network(OTN)
3. [학술지(정기간행물)] - L. Song / 2002 / 10 and 40-Gb/s Forward Error Correction Devices for Optical Communications / IEEE Journal of Solid-State Circuits 37 (11) : 1565 ~ 1573
4. [단행본] - S.B.Wicker / 1995 / Error Control Systems for Digital Communication and Storage / Prentice Hall
5. [학술지(정기간행물)] - H. M. Shao / 1985 / A VLSI Design of a Pipeline Reed-Solomon Decoder / IEEE Trans. on Computers C-34 (5) : 393 ~ 403
2. [학술지(정기간행물)] - ITU-T G.709/Y.133 / 2003 / Interfaces for the Optical Transport Network(OTN)
3. [학술지(정기간행물)] - L. Song / 2002 / 10 and 40-Gb/s Forward Error Correction Devices for Optical Communications / IEEE Journal of Solid-State Circuits 37 (11) : 1565 ~ 1573
4. [단행본] - S.B.Wicker / 1995 / Error Control Systems for Digital Communication and Storage / Prentice Hall
5. [학술지(정기간행물)] - H. M. Shao / 1985 / A VLSI Design of a Pipeline Reed-Solomon Decoder / IEEE Trans. on Computers C-34 (5) : 393 ~ 403
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