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저자정보
Min Han Kong (원광대학교) Young Dong Seo (원광대학교) Moon Kyou Song (원광대학교)
저널정보
대한전자공학회 ICEIC : International Conference on Electronics, Informations and Communications ICEIC : 2008
발행연도
2008.6
수록면
649 - 652 (4page)

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In this paper, a variable Reed-Solomon (RS) decoder with erasure decoding functionality is designed hosed on the modified Euclid's algorithm (MEA). The variahility of the decoder is implemented through shortening and puncturing hosed on the RS (124, 108, 8) code other than the primitive RS (255, 239, 8) code. This leads to shorter decoding latency. The decoder has 4-step pipelined operation, where each step is designed to he clocked hy an independent clock. Thus hy using a faster clock for the MEA block, the complexity and the decoding latency can he reduced. It can support hath continuous-and hurst-mode decoding. It has been designed in VHDL and synthesized in an FPGA chip.

목차

Abstract
1. Introduction
2. Definition of Variable RS Codes
3. Design of a Variable RS Decoder
4. Synthesis and Experiments
5. Conclusions
Acknowledgments
References

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