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논문 기본 정보

자료유형
학술대회자료
저자정보
Jongbok Lee (한성대학교)
저널정보
한국멀티미디어학회 한국멀티미디어학회 국제학술대회 MITA 2009
발행연도
2009.8
수록면
128 - 131 (4page)

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This paper proposes a performance model for superscalar processors which consists of the relationship between component instructions issued per cycle and the size of the instruction window, penalties due to branch mispredictions, instruction cache misses, data cache misses, and the limits from the number of functional units. The key idea is noticing that the average number of each component IPC cannot exceed the dedicated number of each functional unit. Using trace-derived data dependence information, the model can compute performance within accuracy for various window sizes and functional unit configurations without re-executing the whole simulation process.

목차

Abstract
1. Introduction
2. The first-order analytical performance model
3. Simulation Environments
4. Simulation results
5. Conclusions
6. References

참고문헌 (0)

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