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Design of CMOS Tapered Buffer for Minimum Power-delay Product
대한전자공학회 학술대회
1996 .07
최소 지연 시간을 갖는 CMOS buffer 회로의 설계 기법 ( The Design Methodology of Minimum-delay CMOS Buffer Circuits )
전자공학회논문지
1988 .05
최소 delay를 갖는 buffer 회로의 설계 ( A Design of The Buffer Circuit Having Minimum Delay Time )
대한전자공학회 학술대회
1987 .07
A Design of The Buffer Circuit having Minimum Delay Time
대한전기학회 학술대회 논문집
1987 .07
저전력 CMOS테이퍼드 버퍼 회로 ( Low Power CMOS Tapered Buffer Circuit )
대한전자공학회 워크샵
1996 .01
자기조정 이중구동 경로를 가진 새로운 저전력 CMOS 버퍼
전자공학회논문지-SC
2002 .03
A New Delay Model for Large Digital CMOS Circuits
ICVC : International Conference on VLSI and CAD
1997 .01
Design of Two-Stage Class AB CMOS Buffers: A Systematic Approach
[ETRI] ETRI Journal
2011 .06
Design Characteristics of Tapered Couplers in Optical Communication
ICEIC : International Conference on Electronics, Informations and Communications
1998 .01
Design Characteristics of Tapered Couplers in Optical Communication
ICEIC : International Conference on Electronics, Informations and Communications
1998 .08
CMOS 인버터의 지연시간
한국멀티미디어학회 학술발표논문집
1999 .11
CMOS 인버터의 지연 시간 모델 ( A Delay Model for CMOS Inverter )
전자공학회논문지-C
1997 .06
A Simple CMOS Delay Model for Wide Applications
대한전자공학회 기타 간행물
1996 .01
Principles of CMOS System Design
한국통신학회 워크샵
1986 .01
2.5V-2.4㎓ CMOS 전력 증폭기의 설계
대한전자공학회 학술대회
2000 .06
Free Vibrations of Tapered Beams with General Boundary Condition
KSCE JOURNAL OF CIVIL ENGINEERING
2002 .09
A CMOS Multi-phase Delay-Locked Loop for storage media using a 0.18-㎛ CMOS Process
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2005 .07
경사진 봉의 진동 해석
한국소음진동공학회 학술대회논문집
2003 .11
A FAST AND LOW POWER CMOS SRAM WITH LOW-NOISE BUFFER
ICVC : International Conference on VLSI and CAD
1995 .01
DEVICE DESIGN FOR THE LOW POWER CMOS CIRCUIT
ICVC : International Conference on VLSI and CAD
1995 .01
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