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대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : International Technical Conference on Circuits Systems, Computers and Communications 제2권
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    A preprocessor is a substantial element for MPEG-2 video encoder. It processes the input video data, generates the video timing signals, changes RGB to YCbCr, and converts the 444 or 422 format to 420 format. In this paper we introduce new decimation filters and a architecture of the preprocessor for the high-quality video applications such as DTV, VOD, HDTV, etc. Two decimation filters in the proposed preprocessor have longer tabs than usual for high quality color reproduction. Multiplication and accumulation in the decimation filter are simplified to shift and addition by using CSA(Carry Save Adder) tree to be appropriate for the VLSI implementation. Our design is coded by VHDL, synthesized and optimized with 0.5 μm standard cell library, and then verified with 27 MHz clock speed.

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