인문학
사회과학
자연과학
공학
의약학
농수해양학
예술체육학
복합학
DBpia AI
AI 에이전트
AI 아이디어
AI 리더
AI 뷰어
Citeasy
크롬 서지관리 다운로드
개인구독
소속 기관이 없으신 경우, 개인 정기구독을 하시면 저렴하게
논문을 무제한 열람 이용할 수 있어요.
지원사업
학술연구/단체지원/교육 등 연구자 활동을 지속하도록 DBpia가 지원하고 있어요.
커뮤니티
연구자들이 자신의 연구와 전문성을 널리 알리고, 새로운 협력의 기회를 만들 수 있는 네트워킹 공간이에요.
논문 기본 정보
- 저자정보
피인용 0
초록·키워드
This paper describes a VLSI implementation of an array processor for 16-point FFT computation, which consists of 16 processing elements(PEs) working in parallel. Design considerations both in chip level and in PE level have been examined in order to optimize the performance of the array processor. Layout design methodology based on Bit-Slice-Unit(BSU) results in a very fast design and easy debugging, as well as a regular interconnection scheme through abutment. The chip contains about 48,000 transistors and 83 pads on an area of 8.8×8.7 mm². It has been fabricated with a 2 µm, double -metal, P-well CMOS technology. Based on the measurement results, it is estimated that a 16-point FFT can be computed every 3 µsec, and the array processor can perform an equivalent of 24.6 million complex multiplications per second with a 15 MHz clock.
본문·목차
인공지능 문자 인식 모델을 통해 추출된 텍스트로, 일부 오타나 오류가 포함될 수 있으나 지속적으로 개선 중입니다.
오류를 발견하셨다면 해당 부분을 드래그한 후 ' 를 통해 신고해주세요.
오류를 발견하셨다면 해당 부분을 드래그한 후 ' 를 통해 신고해주세요.
최근 본 자료 전체보기
UCI(KEPA) : I410-ECN-0101-2009-569-013327685
