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초록·키워드
This paper describes the design of a high-performance VLSI processor, HiDSP, tailored for digital signal processing. HiDSP supports 24-bit fixed-point arithmetic and 56-bit multiply-and-accumulation operations in parallel. Having been implemented in a 4-stage pipelined datapath, HiDSP completes two data movements in one pipeline stage in parallel with an arithmetic and logic operation. The distributed control logic for interrupt handling and loop processing makes it possible to realize DSP algorithms efficiently. HiDSP has been designed by a top-down approach using VHDL, and implemented by 0.8 μm CMOS gate array technology. Experimental results show that HiDSP executes several benchmark programs faster than DSP56000.
본문·목차
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UCI(KEPA) : I410-ECN-0101-2009-569-013329245
