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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2003.9
- 수록면
- 58 - 65 (8page)
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본 논문은 디지털 회로의 검증 및 테스팅에 유용한 128 채널 하드웨어 시뮬레이터의 구현에 대하여 기술하였다. 하드웨어 시뮬레이터는 로직분석기와 신호발생기의 기능을 동시에 수행한다. 각 채널에 해당하는 코어 모듈은 독립적인 메모리와 내부 모드를 가지고서 하나의 컨트롤러처럼 동작하기 때문에 코어모듈을 추가함으로써 채널 수를 쉽게 확장할 수 있다. 또한 PC를 기반으로 하고 있어 저가형 시스템으로 구현 가능하고, 편리한 GUI(Graphic User Interface) 구성을 할 수 있다. FPGA를 이용하여 구현된 시뮬레이터는 최대 50MHz에서 동작하며 평균 55W의 전력을 소모한다.
목차
Ⅰ. 서론
Ⅱ. 시뮬레이터의 구성
Ⅲ. 코어 모듈
Ⅳ. 구현 및 비교
Ⅴ. 결론
참고문헌
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