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이 논문의 연구 히스토리 (5)
2004
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본 논문에서는 타원곡선 암호 시스템을 위한 스칼라 곱셈기를 유한체 GF(2^163) 상에서 구현하였다 . 스칼라 곱셈 기는 stand basis 를 기반으후 비트 -시리열 곱셈기와 나눗셈기로 구성되어 었으며 이 가운데 가장 많은 시간을 펼
요로 히는 나는 셈의 효율적인 연산을 위해 확장 우「클리드 알고리즘 기반의 새로운 나눗셈 알고리즘을 제안하였다 .
기존의 나눗셈 기들이 가변적인 데이터 종속성으로 인해 제어 모률이 복잡해지며 처리 속도가 느린 것에 비해 새 로이 제안하는 나눗셈 알고리즘은 엽력신호의 크기에 독럽척인 2-bit 의 제어 신호만을 필요로 하기 때문에 기존의 나눗셈 기에 비하여 하드웨어 사이즈 및 처리 속도면에서 유리하다 . 또한 제안하는 나눗셈기의 연산 모듈은 규칙적
인 구조를 가지고 있어 업력 신호의 크기에 따라 확장이 용아하다 새로운 스칼라 곱셈기는 삼성전자 0.18 urn CMOS 공정으로 합성하였을 경우 60,000 게이트의 하드웨어 사이즈를 가지며 최대 250MHz 까지 동작이 가능하다 이 때 데이터 처리속도는 I 48kbps 로 163-bit 프레임당 l.l ms 결린다 . 이러한 성능은 디지털 서명 , 암호화 및 복호 화 그리고 키 교휴않에 효율적으루 사용될 수 있을 것으로 여겨진다 .
요로 히는 나는 셈의 효율적인 연산을 위해 확장 우「클리드 알고리즘 기반의 새로운 나눗셈 알고리즘을 제안하였다 .
기존의 나눗셈 기들이 가변적인 데이터 종속성으로 인해 제어 모률이 복잡해지며 처리 속도가 느린 것에 비해 새 로이 제안하는 나눗셈 알고리즘은 엽력신호의 크기에 독럽척인 2-bit 의 제어 신호만을 필요로 하기 때문에 기존의 나눗셈 기에 비하여 하드웨어 사이즈 및 처리 속도면에서 유리하다 . 또한 제안하는 나눗셈기의 연산 모듈은 규칙적
인 구조를 가지고 있어 업력 신호의 크기에 따라 확장이 용아하다 새로운 스칼라 곱셈기는 삼성전자 0.18 urn CMOS 공정으로 합성하였을 경우 60,000 게이트의 하드웨어 사이즈를 가지며 최대 250MHz 까지 동작이 가능하다 이 때 데이터 처리속도는 I 48kbps 로 163-bit 프레임당 l.l ms 결린다 . 이러한 성능은 디지털 서명 , 암호화 및 복호 화 그리고 키 교휴않에 효율적으루 사용될 수 있을 것으로 여겨진다 .
목차
요약
ABSTRACT
Ⅰ.서론
Ⅱ.구현사례
Ⅲ.타원곡선 암호 알고리즘
Ⅳ.하드웨어 구조
Ⅴ.검증 및 성능 분석
Ⅵ.결론
참고문헌
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