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논문 기본 정보
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- 저널정보
- Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1993년도 가을 학술발표논문집 제20권 제2호
- 발행연도
- 1993.10
- 수록면
- 1,107 - 1,110 (4page)
이용수
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본 논문은 하다마드 변환을 이용한 이차원 이산 여현 변환을 위한 새로운 비트 레벨 시스톨릭 에레이를 제안한다. 이산 여현 변환 알고리듬은 데이타 압축, 이미지 부호화와 필터링에 효율적인 알고리듬이다. 따라서 이를 VLSI화 하기 위하여 방대한 계산량의 처리가 가능한 시스톨릭 어레이가 연구 진행되고 있다. 특히 비트 레벨 시스톨릭 어레이는 PE가 3-4개 정도의 논리소자로 구성되어 있어 계산 시간이 작다는 장점을 가지고 있고 비트패러럴한 방식으로 처리되므로 높은 출력 생성 주기를 갖는다. 제안한 구조는 4*4의 이차원 고속 이산 여현 변환을 시스톨릭 어레이로 설계하고 N*N(N=2ⁿ)크기에 대해 4*4의 구조로 부터 확장가능성을 보여준다. 또한 고속 알고리듬에서 문제가 되는 입력의 변형을 처리하기 위한 전처리부를 설계하여 입출력 매핑을 위한 구조를 보여 준다. 또한 이차원 고속 이산 여현 변환에 사용되는 하다마드단에 제어신호를 주기 위하여 KVGA*(Kernel Value Generating Array)를 구성하였다.
목차
요약
Ⅰ 서론
Ⅱ 2차원 DCT 구조
Ⅲ 2차원 IDCT의 비트 레벨 설계
Ⅳ 시스톨릭 구조의 성능 평가
Ⅴ 결론
참고 문헌
참고문헌 (0)
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