비트 수준 슈퍼 시스톨릭 어레이의 설계

이재진; 송기용

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자료유형: 학술저널

저자정보: 이재진 송기용

저널정보: 대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제12호

발행연도: 2005.12

수록면: 45 - 52 (8page)

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시스톨릭 어레이는 동일한 기능을 가지는 계산처리들을 동일한 형태로 연결하여, 다수의 자료에 반복적인 계산을 하도록 만들어진 병렬처리기로써 개념적으로 산술 파이프라인과 밀접한 관계를 갖는다. 시스톨릭 어레이 셀 내의 연산에 대한 고성능 처리는 시스톨릭 어레이의 중요한 특징이다. 본 논문에서는 시스톨릭 어레이 셀 내의 동시성 처리를 높이기 위해 셀 내의 연산 중에서는 큰 지연 시간을 가지는 셀 내의 연산자를 다시 규칙성을 가지는 시스톨릭 어레이로 구성하는 비트 수준 슈퍼 시스톨릭 어레이 구조를 제안하고, 그 예로 비트 수준 슈퍼 시스톨릭 FIR 필터에 대하여 기술한다. 먼저 정규순환방정식으로 표현된 알고리즘으로부터 워드 수준 시스톨릭 어레이를 유도한 후 유도된 워드 수준 시스톨릭 어레이를 슈퍼 시스톨릭 어레이로 변환한다. 위의 과정으로 유도된 비트 수준 슈퍼 시스톨릭 어레이를 RT 수준에서 VHDL로 모델링 하여 동작을 검증하였으며, Hynix에서 제공되는 0.35㎛셀 라이브러리를 사용하여 합성하였다. 본 논문에서 제안하는 비트 수준 슈퍼 시스톨릭 어레이는 워드 수준 시스톨릭 어레이 디자인에 비해 면적은 물론 성능측면에서 이점을 가진다.

참고문헌 (11)

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[학술지(정기간행물)] - H. T. Kung / 1982. / Why Systolic Architectures? 15 (1) : 37 ~ 46

[학술지(정기간행물)] - S. Y. Kung / 1984. / On Supercomputing with Systolic /Wavefront Array processors 72

[학술지(정기간행물)] - K. T. Johnson / novemver1993. / General Purpose Systolic Arrays : 20 ~ 31

[학술지(정기간행물)] - J. Mccanny / 1990. / The use of data dependence graphs in the design of bit-level systolic arrays 18 : 787793 ~

[학술지(정기간행물)] - / 1999. / High throughput VLSI implementation of discrete orthogonal transforms using bit-level vector-matrix multiplier 46 (5) : 655658 ~

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