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한국조명·전기설비학회 조명·전기설비학회논문지 조명·전기설비학회논문지 제19권 제2호
발행연도
2005.3
수록면
131 - 137 (7page)

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보호계전기는 고장에 의해 파생되는 단락?지락 사고로부터 전력 시스템을 보호하기 위하여 널리 사용되고 있다. 전통적으로 디지털보호계전기는 디지털신호처리 프로세서 혹은 마이크로프로세서로 구현되는데 본 연구는 이를 고성능?고효율?다기능의 단일칩으로 구현하기위한 하드웨어 설계 기술에 관해 다룬다. 제작된 디지털보호계 전기는 FPGA(Field Programmable Gate Array)로 구현하였고 16KSPS이상의 처리 성능을 가지며 평균 오차율 0.03[%]미만으로 보호계전알고리즘을 수행할 수 있다.
#digital signal processing #protective relay

목차

요약
Abstract
1. 서론
2. 사양 정의 및 연산알고리즘 선정
3. 보호계전기를 위한 하드웨어구조
4. 실험 결과
5. 결론
References
◇ 저자소개 ◇

참고문헌 (6)

참고문헌 신청
B. Parhami, “Computer Arithmetic: Algorithms and Hardware Designs”, Oxford University Press, 1999. google schola 마이크로프로세서를 이용한 전자식 배전반 개발(II), 과학기술처, 1990. google schola IEEE Std C37.112-1996, “IEEE Standard Inverse- Time Characteristic Equations for Over-current Relays”, 1997. google schola G. Benmouyal, “Design of a Digital Multi-curve Time-overcurrent Relay”, IEEE Trans. On Power Delivery, Vol. 6, No. 2, pp.656-665, 1991. google schola H. A. Darwish, M. A. Rahman, A. I. Taalab, and H. Shaaban, “Digital model of Overcur-rent Relay Characteristics”, IAS ’95, Vol. 2, pp.1187-1192, 1995. google schola

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