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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2008.11
- 수록면
- 963 - 969 (7page)
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본 논문에서는 무선통신시스템의 수신단에 적용될 수 있는 6비트 100㎒ 플래쉬 A/D 변환기를 설계하였다. 제안하는 플래쉬 A/D 변환기는 해상도가 1비트씩 증가함에 따라 2배수로 증가하는 S-R 래치 회로를 단순화하여 집적화 하였다. 기존 NAND 기반의 S-R 래치 회로에 사용되던 8개의 MOS 트랜지스터 숫자를 6개로 줄였으며, 비교단의 동적 소비전력을 최대 12.5%까지 감소되도록 설계하였다. 설계된 A/D 변환기는 0.18㎛ CMOS n-well 1-poly 6-metal 공정을 사용하여 제작되었고, 전원 전압 1.8V, 샘플링 주파수 100㎒에서의 전력소모는 282㎽이다. 입력 주파수 1.6㎒, 50㎒에서의 SFDR은 각각 35.027㏈c, 31.253㏈c이며, 4.8비트, 4.2비트의 ENOB를 나타내었다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 제안한 6비트 A/D 변환기의 설계
Ⅲ. 6비트 A/D 변환기 레이아웃
Ⅳ. 측정 결과 및 고찰
Ⅴ. 결론
참고문헌
참고문헌 (14)
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1. [학술지(정기간행물)] - Lalitkumar Y. Nathawad / 2003 / A 40-GHz-Bandwidth, 4-bit, Time-Interleaved A/D Converter Using Photoconductive Sampling / IEEE J. Solid-State Circuits 38 : 2021 ~ 2030
2. [학술지(정기간행물)] - Jeny (Heng-Chih) Lin / 2002 / An Embedded 0.8V/480uW 6B/22MHz Flash ADC in 0.13-um Digital CMOS Process Using a Nonlinear Double Interpolation Technique / IEEE J. Solid-State Circuits 38 : 1610 ~ 1617
3. [학술지(정기간행물)] - G. M. Yin / 1992 / A High-Speed CMOS Comparator with 8-b Resolution / IEEE J. Solid-State Circuits 27 : 208 ~ 211
4. [학술지(정기간행물)] - Hui Pan / 2003 / Spatial Filtering in Flash A/D Converter / IEEE Tran. Circuit Syst. II 50 (8) : 208 ~ 211
5. [학술지(정기간행물)] - Klaas Bult / 1997 / An Embedded 240-mW 10-b 50-MS/s CMOS ADC in 1-mm2 / IEEE J. Solid-State Circuits 32 (12) : 1887 ~ 1895
2. [학술지(정기간행물)] - Jeny (Heng-Chih) Lin / 2002 / An Embedded 0.8V/480uW 6B/22MHz Flash ADC in 0.13-um Digital CMOS Process Using a Nonlinear Double Interpolation Technique / IEEE J. Solid-State Circuits 38 : 1610 ~ 1617
3. [학술지(정기간행물)] - G. M. Yin / 1992 / A High-Speed CMOS Comparator with 8-b Resolution / IEEE J. Solid-State Circuits 27 : 208 ~ 211
4. [학술지(정기간행물)] - Hui Pan / 2003 / Spatial Filtering in Flash A/D Converter / IEEE Tran. Circuit Syst. II 50 (8) : 208 ~ 211
5. [학술지(정기간행물)] - Klaas Bult / 1997 / An Embedded 240-mW 10-b 50-MS/s CMOS ADC in 1-mm2 / IEEE J. Solid-State Circuits 32 (12) : 1887 ~ 1895
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