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논문 기본 정보

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저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2009년 SoC학술대회
발행연도
2009.5
수록면
99 - 102 (4page)

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H.264/AVC에서는 블록 기반의 DCT 변환 및 움직임 보상 시 발생하는 block artifact를 제거하기 위해 deblocking filter 를 채택하고 있다. deblocking filter는 4x4 단위의 블록마다 필터링을 수행해야하므로 많은 연산양이 필요한 블록이다. 본 논문에서는 한 개의 single port SRAM과 세 가지 방식의 데이터 경로를 가지는 8x4 픽셀 레지스터를 사용하는 효율적인 deblocking filter를 제안한다. 또한 하나의 line 메모리를 추가해서 현재 매크로블록의 픽셀과 인접한 다른 매크로블록의 픽셀의 접근 및 저장의 효율성을 높였다. 이를 검증하기 위해서 Verilog HDL을 이용하여 설계하였고, 그 합성 결과 0.13um 공정에서 약 20K 개의 gate count를 보였으며, 5120bits의 메모리를 사용하였다.
#H.264 #AVC #deblocking filter #loop filter

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. Deblockgin Filter의 동작
Ⅲ. Proposed Deblocing Filter
Ⅵ. Hardware Implementation Results
Ⅴ. 결론
참고문헌
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UCI(KEPA) : I410-ECN-0101-2009-569-018602176