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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2010.7
- 수록면
- 61 - 69 (9page)
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본 논문에서는 기존 폴딩 구조의 A/D 변환기(ADC)가 지닌 경계조건 비대칭 오차를 극복하기 위해 홀수개의 폴딩 블록을 사용한 1.2V 8b 800MSPS CMOS ADC를 제안한다. 제안하는 ADC는 저 전력소모를 위해 폴딩 구조에 저항열 인터폴레이션 기법을 적용하고, 높은 folding rate(FR=9)를 극복하기 위해 cascaded 폴딩 구조를 채택하였다. 특히 폴딩 ADC의 주된 문제인 아날로그 신호의 선형성 왜곡과 offset 오차 감소를 위해 홀수개의 폴딩 블록을 사용하는 신호처리 기법을 제안하였다. 또한 스위치를 사용한 ROM 구조의 인코더를 채택하여 2<SUP>n</SUP> 주기를 가지지 않는 디지털 코드를 일반적인 바이너리 코드로 출력하였다. 제안하는 ADC는 0.13㎛ 1P6M CMOS 공정을 사용하여 설계되었으며, 유효면적은 870㎛×980㎛이다. 입력주파수 10㎒, 800㎒의 변환속도에서 150㎿의 낮은 전력소모 특성을 보이며 SNDR은 44.84㏈ (ENOB 7.15bit), SFDR은 52.17㏈의 측정결과를 확인하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. ADC 구조 및 회로 설계
Ⅲ. 실험결과
Ⅳ. 결론
참고문헌
저자소개
참고문헌 (13)
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1. [기타자료] - Klaas Bult / 1999 / Analog Broadband Communication Circuits in Pure Digital Deep Sub-Micron CMOS / ISSCC Dig. Tech. Papers
2. [학술지(정기간행물)] - Michael Choi / 2001 / A 6b 1.3Gsample/s A/D Converter in 0.35-um CMOS / IEEE J.Solid-State Circuits 36 (12) : 1847 ~ 1858
3. [학술지(정기간행물)] - 나유삼 / 2001 / 3.3V 8-bit 200MSPS CMOS Folding/Interpolation ADC의 설계 / 대한전자공학 회논문지 38 (3) : 198 ~ 204
4. [기타자료] - Zheng-Yu Wang / 2004 / A 600MSPS 8-bit Folding ADC in 0.18um CMOS / SOVC Dig. Tech. Papers : 424 ~ 427
5. [기타자료] - Kiyoshi Makigawa / 2006 / 7bit 800Msps 120mW folding and Interpolation ADC Using a Mixed-Averaging Scheme / SOVC Dig. Tech. Papers : 138 ~ 139
2. [학술지(정기간행물)] - Michael Choi / 2001 / A 6b 1.3Gsample/s A/D Converter in 0.35-um CMOS / IEEE J.Solid-State Circuits 36 (12) : 1847 ~ 1858
3. [학술지(정기간행물)] - 나유삼 / 2001 / 3.3V 8-bit 200MSPS CMOS Folding/Interpolation ADC의 설계 / 대한전자공학 회논문지 38 (3) : 198 ~ 204
4. [기타자료] - Zheng-Yu Wang / 2004 / A 600MSPS 8-bit Folding ADC in 0.18um CMOS / SOVC Dig. Tech. Papers : 424 ~ 427
5. [기타자료] - Kiyoshi Makigawa / 2006 / 7bit 800Msps 120mW folding and Interpolation ADC Using a Mixed-Averaging Scheme / SOVC Dig. Tech. Papers : 138 ~ 139
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