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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.1
- 수록면
- 35 - 42 (8page)
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본 논문에서는 유한체 GF(2<SUP>M</SUP>)상에서 모든 항에 0이 아닌 계수가 존재하는 기약 다항식에 대한 승산 알고리즘을 제시하였으며, 제시된 승산 알고리즘을 이용하여 고속의 병렬 입-출력 모듈구조의 승산기를 구성하였다. 제시한 승산기의 구성은 (m+1)²개의 동일한 기본 셀들로 설계되었으며, 제시한 기본 셀은 2입력 XOR 게이트와 2입력 AND 게이트로 구성하였다. 셀에 래치를 사용하지 않았으므로 회로가 간단하며, 셀당 지연시간이 T<SUB>A</SUB>+T<SUB>X</SUB>이다. 본 연구에서 제안한 승산기는 규칙성과 셀 배열에 의한 모듈성을 가지므로 m이 큰 회로의 확장이 용이하며 VLSI회로 실현에 적합할 것이다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 유한체 GF(2m)상에서의 승산 알고리즘
Ⅲ. 유한체 GF(2⁴)상에서의 승산기 구성
Ⅳ. 비교 및 검토
Ⅴ. 결론
참고문헌
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1. [학술지(정기간행물)] - H. M. Shao / 1985 / A VLSI Design of a Pipelining Reed-Solomon Decoder / IEEE Trans. Computers C-34 : 393 ~ 403
2. [학술지(정기간행물)] - C. C. Wang / 1985 / VLSI Architecture for Computing Multiplications and Inverses in / IEEE Trans. Computers C-34 : 707 ~ 717
3. [학술지(정기간행물)] - P. E. Scott / 1986 / A Fast VLSI Multiplier for / IEEE Journal Selected Areas in Comunications SAL-4 (1) : 62 ~ 65
4. [학술대회논문] - N. Iliev / 2004 / Parallel Programmable Finite Field Multiplier / IEEE Int. Symp. VLSI Emerging Trends in VLSI Systems Design
5. [학술지(정기간행물)] - C. S. Yeh / 1984 / Systolic Multipliers for Finite Fields / IEEE Trans. Computers 33 (4) : 357 ~ 360
2. [학술지(정기간행물)] - C. C. Wang / 1985 / VLSI Architecture for Computing Multiplications and Inverses in / IEEE Trans. Computers C-34 : 707 ~ 717
3. [학술지(정기간행물)] - P. E. Scott / 1986 / A Fast VLSI Multiplier for / IEEE Journal Selected Areas in Comunications SAL-4 (1) : 62 ~ 65
4. [학술대회논문] - N. Iliev / 2004 / Parallel Programmable Finite Field Multiplier / IEEE Int. Symp. VLSI Emerging Trends in VLSI Systems Design
5. [학술지(정기간행물)] - C. S. Yeh / 1984 / Systolic Multipliers for Finite Fields / IEEE Trans. Computers 33 (4) : 357 ~ 360
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