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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.9
- 수록면
- 50 - 57 (8page)
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전형적인 버스 시스템 아키텍처는 마스터, 아비터, 디코더, 슬레이브와 같은 성분으로 구성되어 있다. 아비터는 여러 마스터가 동시에 버스를 사용하지 못하므로 선택된 버스중재 방식에 따라 버스를 중재하는 역할을 한다. 고성능을 위해 사용되는 일반적인 우선순위 방법에는 고정 우선순위, 라운드 로빈, TDMA, 로터리 방식 등이 있다. 일반적인 버스 중재 알고리즘은 버스 점유율을 고려하지 않고, 버스중재를 실시한다. 본 연구에서는 각각의 마스터 블록에서 버스 점유율을 계산한 버스 중재방식에 대해 제안하고 있다. TLM 성능분석 방식을 통해 제안하는 방식과 기존의 다른 버스 중재방식의 성능을 분석하였다. 성능검증 결과에서 일반적인 고정우선순위와 라운드로빈 방식은 버스점유율을 설정할 수 없었으며, TDMA와 로터리 중재방법은 100,000 cycle의 시뮬레이션에서 각각 50%와 70%의 버스점유율 오차가 발생하였다. 그러나, 제안하는 점유율 고려방식에서는 1,000cycle이상에서부터 99%이상 정확도를 보였다.
목차
요약
Abstract
Ⅰ. INTRODUCTION
Ⅱ. Concept of bandwidth-aware bus arbitration
Ⅲ. Performance analysis
Ⅳ. Conclusions
REFERENCES
저자소개
참고문헌 (9)
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1. [학술지(정기간행물)] - R. Lu / 2007 / SAMBA-Bus: A High Performance Bus Architecture for System-on-Chips / IEEE Trans. on VLSI Systems 15 (1) : 69 ~ 79
2. [학술대회논문] - E. Salminen / 2002 / Overview of bus-based system-on-chip interconnections / Proc. IEEE Int. Symp. Circuits Syst. : II-372 ~ II-375
3. [학술지(정기간행물)] - L. Benini / 2002 / Networks on chips: A new SoC paradigm / IEEE Comput. 35 : 70 ~ 78
4. [학술지(정기간행물)] - M. Jun / 2007 / Latency-aware bus arbitration for real-time embedded systems / IEICE Trans. Inf.& Syst. E90-D (3)
5. [학술대회논문] - Y. Xu / 2006 / An Adaptive Dynamic Arbiter for Multi-Processor SoC / Solid-State and Integrated Circuit Technology International Conf. : 1993 ~ 1996
2. [학술대회논문] - E. Salminen / 2002 / Overview of bus-based system-on-chip interconnections / Proc. IEEE Int. Symp. Circuits Syst. : II-372 ~ II-375
3. [학술지(정기간행물)] - L. Benini / 2002 / Networks on chips: A new SoC paradigm / IEEE Comput. 35 : 70 ~ 78
4. [학술지(정기간행물)] - M. Jun / 2007 / Latency-aware bus arbitration for real-time embedded systems / IEICE Trans. Inf.& Syst. E90-D (3)
5. [학술대회논문] - Y. Xu / 2006 / An Adaptive Dynamic Arbiter for Multi-Processor SoC / Solid-State and Integrated Circuit Technology International Conf. : 1993 ~ 1996
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