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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2013.4
- 수록면
- 7 - 13 (7page)
- DOI
- 10.14801/kiitr.2013.11.4.7
이용수
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에너지 소비를 감소하기 위한 최적화 연구는 하드웨어 및 소프트웨어 설계에서 중요한 쟁점으로 등장하고 있다. 하드웨어에서 실행되는 소프트웨어에 대한 에너지 소비는 운영체제, 실행시간 환경, 컴파일러, 어플리케이션 등이 복잡한 상호 작용을 통해 이루어진다. 특히, 임베디드 시스템에서 동작하는 어플리케이션은 전체 에너지 소비에서 상당한 영향력을 가지고 있으며, 에너지 소비가 우선적으로 고려된 최적화 기능을 갖는 에너지-중심의 컴파일 기술에 대한 조사와 연구의 필요성이 중요하게 되었다. 이 논문에서는 ARM 아키텍처를 위한 Machine-SUIF 후단부에 에너지 소비를 줄이기 위한 에너지-지향 인스트럭션 스케줄링을 적용하였다. 이를 위하여 스케줄링을 위한 자료 의존 그래프(Data Dependency Graph)를 구성하고 이를 탐색하면서 목적에 맞는 스케줄링 된 코드를 생성한다. 생성된 코드에 대한 에너지 소비 효율성을 증명하고 실험하기 위해서 ARM 아키텍처에서 소비하는 에너지를 측정할 수 있는 Sim-Panalyzer 시뮬레이터를 이용하여 결과를 제시한다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 관련 연구
Ⅲ. 에너지 효율적인 인스트럭션 스케줄링
Ⅳ. 결론 및 향후 연구내용
참고문헌
참고문헌 (11)
참고문헌 신청
1. [단행본] - Y. Srikant / 2008 / Energy-aware Compiler Optimizations, in The Compiler Design Handbook: Optimizations and Machine Code Generation / CRC Press : 235 ~ 265
2. [학술대회논문] - Kyuwon Choi. / 2001 / Efficient Instruction-Level Optimization Methodology for Low Power Embedded Systems / ISSS 2001
3. [학술지(정기간행물)] - R. Leaupers / 2002 / Compiler Design Issues for Embedded Processors / IEEE Design & Test of Computers : 2 ~ 9
4. [학술지(정기간행물)] - Timothy M. Jones / 2009 / Energy-Efficient Register Caching with Compiler Assistance / ACM Transactions on Architecture and Code Optimization, Article 13 6 (4) : 1 ~ 23
5. [학술지(정기간행물)] - Meikang Qiu / 2009 / Energy-aware Loop Scheduling and Assignment for Multi-core, Multifunctional Unit Architecture / Journal of Signal Processing System 57 : 363 ~ 379
2. [학술대회논문] - Kyuwon Choi. / 2001 / Efficient Instruction-Level Optimization Methodology for Low Power Embedded Systems / ISSS 2001
3. [학술지(정기간행물)] - R. Leaupers / 2002 / Compiler Design Issues for Embedded Processors / IEEE Design & Test of Computers : 2 ~ 9
4. [학술지(정기간행물)] - Timothy M. Jones / 2009 / Energy-Efficient Register Caching with Compiler Assistance / ACM Transactions on Architecture and Code Optimization, Article 13 6 (4) : 1 ~ 23
5. [학술지(정기간행물)] - Meikang Qiu / 2009 / Energy-aware Loop Scheduling and Assignment for Multi-core, Multifunctional Unit Architecture / Journal of Signal Processing System 57 : 363 ~ 379
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