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본 연구에서는 8K UHD(7680×4320) 영상을 실시간 부호화하기 위한 4×4 블록 부화소 움직임추정기를 제안한다. 연산처리성능을 향상시키기 위해 보간 연산을 4×4 블록 단위로 병렬화시켰으며, 병렬 보간 연산에서 필요한 메모리 대역폭을 확장하기 위해 10×10개의 메모리 어레이를 가진 2D 캐쉬 버퍼 구조를 설계하였다. 그리고 2D 캐쉬 버퍼는 검색영역 간 재사용 기법을 적용하여 참조화소의 중복저장을 최소화하였으며, 4×4 블록 병렬 보간 필터는 3단(수평·수직 1/2부화소, 대각선 1/2부화소, 1/4 부화소) 평면 보간 연산 파이프라인 구조로 설계하여 연산회로를 고속화시켰다. 0.13㎛ 공정에서 시뮬레이션한 결과, 436.5K게이트의 4×4 블록 부화소 움직임추정기는 동작주파수 187㎒에서 8K UHD급 동영상을 초당 30프레임으로 실시간 처리하는 성능을 보였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. H.264/AVC 4×4 블록 부화소 움직임추정
Ⅲ. 4×4블록 부화소 움직임추정기 아키텍처
Ⅳ. 실험 및 분석
Ⅴ. 결론
REFERENCES
참고문헌 (12)
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1. [기타자료] - / 2003 / Draft ITU-T Recommendation and Final Draft International Standard of Joint Video Specification, ITU-T Recommendation H.264 and ISO/IEC14496-10 AVC / Joint Video Team
2. [학술대회논문] - Tung-Chien Chen / 2006 / Low power and power aware fractional motion estimation of H. 264/AVC for mobile applications / IEEE International Symp. on Circuits and Systems : 5331 ~ 5334
3. [학술대회논문] - Jin Soo Kim / 2008 / Novel fractional pixel motion estimation algorithm using motion prediction and fast search pattern / IEEE International Conference on Multimedia and Expo : 821 ~ 824
4. [학술지(정기간행물)] - Tung-Chien Chen / 2006 / Analysis and architecture design of an HDTV720p 30 frames H. 264/AVC encoder / IEEE Transactions on Circuits and Systems for Video Technology 16 : 673 ~ 688
5. [학술지(정기간행물)] - Changqi Yang / 2006 / High performance VLSI architecture of fractional motion estimation in H. 264 for HDTV / IEEE International Symp. on Circuits and Systems : 2605 ~ 2608
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3. [학술대회논문] - Jin Soo Kim / 2008 / Novel fractional pixel motion estimation algorithm using motion prediction and fast search pattern / IEEE International Conference on Multimedia and Expo : 821 ~ 824
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5. [학술지(정기간행물)] - Changqi Yang / 2006 / High performance VLSI architecture of fractional motion estimation in H. 264 for HDTV / IEEE International Symp. on Circuits and Systems : 2605 ~ 2608
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