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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2014.11
- 수록면
- 90 - 93 (4page)
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The international video compressing standard HEVC uses the interpolation technique to produce sub-pixels for efficiency and accuracy. Many researches are necessary for the HEVC interpolation because of the increased computational complexity compared to the former standard H.264/AVC. This paper proposes an architecture of the efficient HEVC interpolation circuit. The proposed circuit was synthesized using 130nm standard cell library. It consists of 106.693 gates and the maximum operating frequency is 200MHz. It processes more than 70 frames per second for 4K-UHD images.
목차
Abstract
I. 서론
II. HEVC 보간
Ⅲ. 제안하는 회로
Ⅳ. 결론
참고문헌
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