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VLSI의 논리 회로 최적화를 위한 Rule-Based System
대한전자공학회 학술대회
1985 .06
VLSI 게이트 레벨 논리설계 최적화를 위한 Rule-Based 시스템 ( A Rule-Based System for VLSI Gate-Level Logic Optimization )
전자공학회논문지
1989 .01
A Rule-Based System for VLSI Gate-level Logic Optimization
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1988 .01
VLSI Design
대한전자공학회 단기강좌
1983 .01
저 전력을 위한 VLSI 설계 최적화 ( Lower Power Driven VLSI Design Optimization )
CAD 및 VLSI 설계연구회지
1995 .01
VLSI 기술언어 시스템상에서의 논리회로 시뮬레이터 설계 ( Design of a Logic Simulation on VLSI Description Language Systems )
대한전자공학회 학술대회
1992 .11
VLSI의 신뢰성 ( Reliability Issues in VLSI )
대한전자공학회 학술대회
1987 .05
VLSI설계와 CAD기술개발
전자진흥
1985 .01
테스트 패턴 생성이 용이한 VLSI 논리 설계 방식 ( A VLSI Logic Design Structure for Reduction of Test pattern Generation Effort )
대한전자공학회 학술대회
1985 .01
VLSI 한계
대한전자공학회 단기강좌
1983 .01
CMOS VLSI 회로에서 논리추출을 위한 효율적인 알고리즘 ( An Efficient Logic Extraction Algorithm for CMOS VLSI Circuits )
대한전자공학회 학술대회
1988 .01
VLSI 논리설계 최적화를 위한 Redundancy 조사 가속화에 관한 연구 ( On the Acceleration of Redundancy Identification for VLSI Logic Optimization )
전자공학회논문지
1990 .03
VLSI 설계 자동화에 대한 연구
제어로봇시스템학회 국내학술대회 논문집
1986 .10
VLSI System CAD에 관한 硏究
한국통신학회논문지
1983 .04
VLSI Design of HAS-160 Algorithm
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2003 .07
A study on form of logical circuit for VLSI by B-tree
한국정보과학회 학술발표논문집
1995 .11
VLSI 자동설계기술 ( Design Automation for VLSI )
대한전자공학회 학술대회
1987 .01
Built-In Self-Test 방식을 사용한 VLSI 논리설계 ( Built-In Self Test Structures for VLSI )
대한전자공학회 학술대회
1985 .01
VLSI System CAD에 관한 연구 ( A Study on Compute Aided VLSI System Design )
한국통신학회지(정보와통신)
1983 .04
신경망 스위칭 최적화 알고리즘의 VLSI 구현 ( VLSI Implementation of Neural Network Switching Optimization Algorithm )
CAD 및 VLSI 설계연구회지
1996 .01
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