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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC 2015
- 발행연도
- 2015.6
- 수록면
- 1,008 - 1,011 (4page)
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A 3.6V CMOS rail-to-rail operational amplifier with a novel constant g<SUB>m </SUB>(transconductance) biasing circuit is proposed. The rail-to-rail input stage is realized by connecting two complementary differential pairs in parallel. To obtain constant g<SUB>m</SUB> across the whole common mode input range, the drain currents of differential pairs are precisely controlled by proposed biasing circuit. This design is verified by simulation using a 0.18㎛ CMOS process. Simulation result shows a rail-to-rail input/output range and a constant g<SUB>m</SUB> with ±2.45% variation. Also an open loop gain of 88dB, unity gain bandwidth of 1.17MHz and phase margin of 63° are achieved.
목차
Abstract
1. Introduction
2. Rail-to-rail input stage with constant gm
3. Proposed rail-to-rail operational amplifier
4. Simulation results
5. Conclusions
References
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