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저널정보
한국컴퓨터정보학회 한국컴퓨터정보학회논문지 한국컴퓨터정보학회 논문지 제10권 제2호
발행연도
2005.5
수록면
49 - 57 (9page)

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이 논문의 연구 히스토리 (7)

2008

시간제약 조건하에서 면적을 고려한 LE로 구성된 CPLD 기술 매핑
김재진 ,  장인갑 ,  허윤석 한국정보기술학회논문지 2008.06 학술저널

2005

시간 제약 조건과 면적을 고려한 효율적인 CPLD 기술 매핑
김재진 ,  이관형 한국컴퓨터정보학회논문지 2005.07 학술저널
상관관계에 의한 CLB구조의 CPLD 저전력 기술 매핑 알고리즘
김재진 ,  이관형 한국컴퓨터정보학회논문지 2005.05 학술저널

2003

면적과 지연 시간을 고려한 CLB 구조의 CPLD 저전력기술 매핑 알고리즘
김재진 ,  조남경 ,  전종식 외 1명 대한전자공학회 학술대회 2003.07 학술대회자료
CLB 구조의 CPLD 저전력 기술 매핑 알고리즘
김재진 ,  윤충모 ,  인치호 외 1명 대한전자공학회 학술대회 2003.07 학술대회자료

2002

시간 제약 조건 하에서 저전력을 고려한 CLB구조의 CPLD 기술 매핑 알고리즘
김재진 ,  김희석 전자공학회논문지-SD 2002.08 학술저널

2001

CLB를 기저로한 저전력 CPLD 기술 매핑 알고리즘
김재진 ,  인치호 ,  김희석 대한전자공학회 기타 간행물 2001.11 연구보고서

초록· 키워드

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본 논문은 상관관계(trade-off)에 의한 CLB구조의 CPLD 저전력 기술 매핑 알고리즘을 제안하였다. 제안한 저전력 기술 매핑 알고리즘은 주어진 불린 네트워크를 DAG로 구성하여 소모전력 계산을 위한 TD(Transition Density) 계산 단계와 매핑 가능 클러스터 생성, CLB 패킹의 단계로 구성하였다. TD 계산 단계는 DAG를 구성하고 있는 각 노드들에 대한 스위칭 동작을 계산하여 전체 소모 전력을 계산하는 단계이다. 매핑 가능 클러스터 생성 단계는 주어진 CPLD의 CLB에 대한 입출력의 수와 OR 텀수를 고려하여 매핑 가능 클러스터를 생성하는 단계이다. 매핑 가능 클러스터를 생성하기 위하여 공통 노드 클러스터 병합과 노드 분할, 노드 복제의 방법을 이용한다. 제안된 알고리즘을 SIS에서 제공되는 벤치마크에 적용하여 실험한 결과 OR 텀수를 5로 했을 경우 기존의 CPLD 기술 매핑 알고리즘인 TEMPLA에 비해 30.73% 의 소모전력이 감소되었으며, PLAmap에 비해 17.11% 감소되었다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. 관련 연구

Ⅲ. 전력 모델

Ⅳ. 상관 관계를 고려한 CPLD 저전력 기술매핑 알고리즘

Ⅴ. 실험 결과

Ⅵ. 결론

참고문헌

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시간제약 조건을 고려한 CPLD 기술 매핑 알고리즘 개발 ( Development of Technology Mapping Algorithm for CPLD by Considering Time Constraint )
김희석 ,  변상준 전자공학회논문지-C 1999 .06

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