전달 루틴의 병렬화를 통한 SAT 알고리즘의 GPGPU 가속화

강형주

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자료유형: 학술저널

저자정보: 강형주 (한국기술교육대학교)

저널정보: 한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제20권 제10호

발행연도: 2016.10

수록면: 1,919 - 1,926 (8page)

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대량의 데이터를 병렬적으로 처리할 수 있는 General-Purpose Graphics Processing Unit(GPGPU)가 최근 많은 분야에서 적용되고 있으며, 이는 전자 설계 자동화 분야에서도 예외가 아니다. SAT 알고리즘은 다양한 전자 설계 자동화 문제에 적용되는 대표적인 알고리즘 중 하나이다. GPGPU를 이용해서 SAT 알고리즘을 가속화하기 위해 노력이 이루어져 왔으나, SAT 알고리즘 자체의 특성으로 인해 병렬화에 어려움이 있어왔다. 이 논문에서는 SAT 알고리즘의 내부 과정 중 비교적 병렬화가 용이한 전달 루틴을 병렬화함으로써 GPGPU 가속화를 적용하였다. 전달 루틴이 희소 행렬의 곱셈과 유사한 점에 착안하여 데이터 구조를 구성하고 이에 맞추어서 병렬적인 전달 루틴을 작성하였다. 병렬적으로 동작하는 쓰레드들 사이의 데이터 손실을 방지하기 위해 아토믹(atomic) 연산을 이용하였다. 벤치마크 SAT 문제들에 대해 기존의 GPGPU 기반 SAT solver에 비해 성능이 10배 이상 향상되었음을 확인하였다.

#GPGPU #SAT 알고리즘 #병렬화 #알고리즘 가속화 #회로 설계 자동화 #SAT Algorithm #Parallelization #Algorithm Acceleration #Electronics Design Automation

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[학술대회논문] - Y. Deng / 2010 / GPU Accelerated VLSI Design Verification / Proceedings of International Conference on Computer and Information Technology : 1213 ~ 1218

[학술대회논문] - Y. Deng / 2009 / Taming irregular EDA applications on GPUs / Proceedings of International Conference on Computer Aided Design : 539 ~ 546

[학술지(정기간행물)] - J. P. M.-Silva / 1999 / GRASP: A Search Algorithm for Propositional Satisfiability / IEEE Transactions on Computers 48 (5) : 506 ~ 521

[학술대회논문] - M. W. Moskewicz / 2001 / Chaff: Engineering an Efficient SAT Solver / Proceedings of Design Automation Conference : 530 ~ 535

[학술대회논문] - N. Een / 2003 / An Extensible SAT-solver / Proceedings of International Conference on Theory and Applications of Satisfiability Testing : 502 ~ 518

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