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저자정보
조욱래 (금오공과대학교) 김기쁨 (금오공과대학교) 배기철 (금오공과대학교) 신경욱 (금오공과대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제20권 제11호
발행연도
2016.11
수록면
2,093 - 2,099 (7page)

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PRESENT, ARIA, AES의 3가지 블록 암호 알고리듬을 지원하는 다중 암호 프로세서 설계에 대해 기술한다. 설계된 암호 칩은 PRmo (PRESENT with mode of operation), AR_AS (ARIA_AES) 그리고 AES-16b 코어로 구성된다. 64-비트 블록암호 PRESENT를 구현하는 PRmo 코어는 80-비트, 128-비트 키 길이와 ECB, CBC, OFB, CTR의 4가지 운영모드를 지원한다. 128-비트, 256-비트 키 길이를 지원하는 AR_AS 코어는 128-비트 블록암호 ARIA와 AES를 자원공유 기법을 적용하여 단일 데이터 패스로 통합 구현되었다. 128-비트 키 길이를 지원하는 AES-16b 코어는 저면적 구현을 위해 16-비트의 데이터패스로 설계되었다. 각 암호 코어는 on-the-fly 키 스케줄러를 포함하고 있으며, 평문/암호문 블록의 연속적인 암호/복호화 처리가 가능하다. FPGA 검증을 통해 설계된 다중 블록 암호 프로세서의 정상 동작을 확인하였다. 0.18㎛ 공정의 CMOS 셀 라이브러리로 합성한 결과, 54,500 GEs (gate equivalents)로 구현이 되었으며, 55 MHz의 클록 주파수로 동작 가능하다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 블록 암호 알고리듬
Ⅲ. 다중 블록 암호 프로세서 설계
Ⅳ. 기능검증 및 레이아웃 설계
Ⅴ. 결론
REFERENCES

참고문헌 (11)

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