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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2010.4
- 수록면
- 1,222 - 1,228 (7page)
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고속 PMIC를 위한 빠른 천이 응답 시간을 가지는 CMOS LDO 레귤레이터를 설계하였다. 제안하는 LDO 레귤레이터 회로는 기준전압회로와 오류증폭회로, 파워 트랜지스터 등으로 이루어지며, 출력전압의 안정성을 높이기 위하여 오류증폭 회로와 파워 트랜지스터 사이에 버퍼로써 2단 광대역 OTA를 추가하였다. 기존의 연구에서 제안된 가장 간단하게 구현할 수 있는 버퍼로는 소스팔로워 구조가 있으나, 출력 스윙이 좁고 신호 대 잡음비가 저하되는 문제점이 있었다. 본 논문에서는 2단 광대역 OTA를 버퍼로 사용하여 LDO 전압 레귤레이터의 출력 특성을 개선하 였다. 0.5 ㎛ CMOS 공정을 이용하여 모의실험 한 결과, 라인 레귤레이션은 16 mV/V, 부하 레귤레이션 0.007 %/mA 를 얻었다.
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참고문헌 (10)
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1. [학술지(정기간행물)] - Hoi Lee,T / 2005 / A design of low-power analog drivers based on slew-rate enhancement circuits for cmos low-dropout regulators / IEEE.J.Solid-State Circuit, 52 (9) : 563 ~ 567
2. [학술지(정기간행물)] - Man Siu / 2006 / A voltage-mode pwm buck regulator with end-point prediction / IEEE TCAS II, 53 (4) : 294 ~ 298
3. [학술지(정기간행물)] - P. Hazucha / 2005 / Area-efficient linear regulator with ultra-fast load regulation / IEEE.J.Solid-State Circuit 40 (4) : 933 ~ 940
4. [학술지(정기간행물)] - Kaiwei Yao / 2003 / Optimal design of the active droop control method for the transient response / Applied Power Electronics Conference and Exposition 2 : 718 ~ 723
5. [학술지(정기간행물)] - G.A.Rincon-Mora / 2000 / Active capacitor multiplier in miller-compensated circuits / ,IEEE J.Solid-State Circuits 35 : 26 ~ 32
2. [학술지(정기간행물)] - Man Siu / 2006 / A voltage-mode pwm buck regulator with end-point prediction / IEEE TCAS II, 53 (4) : 294 ~ 298
3. [학술지(정기간행물)] - P. Hazucha / 2005 / Area-efficient linear regulator with ultra-fast load regulation / IEEE.J.Solid-State Circuit 40 (4) : 933 ~ 940
4. [학술지(정기간행물)] - Kaiwei Yao / 2003 / Optimal design of the active droop control method for the transient response / Applied Power Electronics Conference and Exposition 2 : 718 ~ 723
5. [학술지(정기간행물)] - G.A.Rincon-Mora / 2000 / Active capacitor multiplier in miller-compensated circuits / ,IEEE J.Solid-State Circuits 35 : 26 ~ 32
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