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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2018.10
- 수록면
- 531 - 537 (7page)
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스퍼의 크기를 줄이기 위해 델타-시그마 변조기와 스퍼감소회로가 도입된 위상고정루프(PLL)를 제안하였다. 델타-시그마 변조기는 스퍼 잡음을 높은 주파수 대역으로 이동시켜 루프필터가 잡음 제거를 쉽게 할 수 있도록 해준다. 이는 위상고정루프의 대역폭을 적절히 조절하면 스퍼 크기를 크게 감소시킬 수 있다. 스퍼감소회로는 한주기당 발생하는 루프필터 전압변화를 작게 하여 스퍼 크기가 감소되도록 한다. 제안한 스퍼감소회로는 위상고정 루프의 크기에 거의 영향이 없을 정도로 간단하게 설계하였다. 이 두 가지 방법을 사용한 제안된 위상고정루프는 0.18m CMOS 공정에서 1.8V의 공급전압으로 설계되었으며, 시뮬레이션을 통해 제안된 위상고정루프의 스퍼 크기가 거의 20dB 감소된 것을 확인하였다. 스퍼의 크기가 크게 감소된 위상고정루프는 대역폭이 좁은 통신시스템에 크게 활용될 수 있다.
목차
요약
Abstract
1. 서론
2. 제안한 위상고정루프 회로
3. 회로 설계
4. 시뮬레이션 결과
5. 결론
REFERENCES
참고문헌 (11)
참고문헌 신청
이원희 / 2017 / 무선통신 환경에서 음성파형 보상을 통한 음주가능성 여부에 관한 연구 / 한국인터넷방송통신학회 논문지 17(3):47~53
[학술대회논문] - Y. Lee / 2017 / A -242-dB FOM and -71-dBc reference spur ring VCO based ultra low jitter switched loop filter PLL using a fast phase-error correction technique / VLSI Circuits Symposium on : 186 ~ 187
[학술지(정기간행물)] - A. Rao / 2008 / A 4-6.4 GHz LC PLL with adaptive bandwidth control for a forward clock link / IEEE Journal of Solid-State Circuits 43 (9) : 2099 ~ 2108
[학술지(정기간행물)] - W. B. Wilson / 2000 / A CMOS self-calibrating frequency synthesizer / IEEE Journal of Solid-State Circuits 35 : 1437 ~ 1444
[학술지(정기간행물)] - Wu-Hsin Chen / 2012 / A 0.5-V, 440-${\mu}$ W Frequency Synthesizer for Implantable Medical Devices / IEEE Journal of Solid-State Circuits 47 (8) : 1896 ~ 1907
[학술대회논문] - Y. Lee / 2017 / A -242-dB FOM and -71-dBc reference spur ring VCO based ultra low jitter switched loop filter PLL using a fast phase-error correction technique / VLSI Circuits Symposium on : 186 ~ 187
[학술지(정기간행물)] - A. Rao / 2008 / A 4-6.4 GHz LC PLL with adaptive bandwidth control for a forward clock link / IEEE Journal of Solid-State Circuits 43 (9) : 2099 ~ 2108
[학술지(정기간행물)] - W. B. Wilson / 2000 / A CMOS self-calibrating frequency synthesizer / IEEE Journal of Solid-State Circuits 35 : 1437 ~ 1444
[학술지(정기간행물)] - Wu-Hsin Chen / 2012 / A 0.5-V, 440-
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