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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2018.6
- 수록면
- 514 - 517 (4page)
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센서 시스템의 아날로그-디지털 변환기(ADC: analog-to-digital converter)에서는 높은 해상도, 낮은 전력 소모, 높은 신호 대역폭이 요구된다. 시그마-델타 ADC는 높은 차수 구조와 높은 오버샘플링 비를 통해 고해상도를 얻을 수 있으나 전력 소모가 높고 신호 대역폭이 낮다. 연속 근사 레지스터(SAR: successive-approximation-register) ADC의 경우 저전력 동작이 가능하나 공정상 부정합으로 인해 해상도에 한계가 있다. 본 논문에서는 이러한 단점들을 극복하기 위한 ADC 구조 개선에 대해 살펴본다.
목차
Abstract
요약
Ⅰ. 서론
Ⅱ. 시그마-델타 ADC의 구조 개선
Ⅲ. SAR ADC의 구조 개선
Ⅳ. 결론
References
참고문헌 (20)
참고문헌 신청
[학술지(정기간행물)] - W. Kester / 2005 / Which ADC Architecture Is Right for Your Application? / Analog Dialogue
[학술지(정기간행물)] - 최정열 / 2017 / 고해상도, 저잡음 캐패시턴스 디지털 신호 변환기 / 전자공학회논문지 54 (12) : 81 ~ 87
[인터넷자원] - Maxim / 0000 / Understanding SAR ADCs: Their Architecture and Comparison with Other ADCs
[학술지(정기간행물)] - S. Choi / 2018 / An 84.6-dB-SNDR and 98.2-dB-SFDR Residue-Integrated SAR ADC for Low-Power Sensor Applications / IEEE Journal of Solid-State Circuits 53 (2) : 404 ~ 417
[학술지(정기간행물)] - S. Wu / 2013 / A 81-dB Dynamic Range 16-MHz Bandwidth Delta-Sigma Modulator Using Background Calibration / IEEE Journal of Solid-State Circuits 48 (9) : 2170 ~ 2179
[학술지(정기간행물)] - 최정열 / 2017 / 고해상도, 저잡음 캐패시턴스 디지털 신호 변환기 / 전자공학회논문지 54 (12) : 81 ~ 87
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[학술지(정기간행물)] - S. Choi / 2018 / An 84.6-dB-SNDR and 98.2-dB-SFDR Residue-Integrated SAR ADC for Low-Power Sensor Applications / IEEE Journal of Solid-State Circuits 53 (2) : 404 ~ 417
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