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논문 기본 정보
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- 학술저널
- 저자정보
- 저널정보
- Korean Institute of Information Scientists and Engineers Journal of Computing Science and Engineering Journal of Computing Science and Engineering Vol.12 No.4
- 발행연도
- 2018.12
- 수록면
- 170 - 179 (10page)
- DOI
- 10.5626/JCSE.2018.12.4.170
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As major architectural changes emerge to resolve the scalability issues in many-core processors, it is critical to understand their impact on the performance of parallel programming models and run-time supports. For example, the Intel Xeon Phi KNL processor is equipped with a high-bandwidth memory and deploys a mesh-based processor interconnect. In this paper, we comprehensively analyze the impact of high-bandwidth memory and processor interconnects on the message passing interface (MPI) communication bandwidth. The results show that the bandwidth of MPI intra-node communication can be improved up to 372% by exploiting the high-bandwidth memory. In addition, we show that the bandwidth of MPI inter-node communication can be improved up to 143% with optimal core affinity. Our comprehensive study provides insight into optimization of the performance of MPI communication in emerging manycore architectures.
목차
Abstract
I. INTRODUCTION
II. BACKGROUND
III. IMPACT OF HIGH-BANDWIDTH MEMORY
IV. IMPACT OF PROCESSOR INTERCONNECT
V. RELATED WORK
VI. CONCLUSIONS
REFERENCES
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