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학술저널
저자정보
Yongchul Jung (Korea Aerospace University) Jaechan Cho (Korea Aerospace University) Seongjoo Lee (Sejong University) Yunho Jung (Korea Aerospace University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.19 No.3
발행연도
2019.6
수록면
246 - 253 (8page)
DOI
10.5573/JSTS.2019.19.3.246

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We propose an area-efficient fast Fourier transform (FFT) processor for hand gesture recognition (HGR) radar and present its hardware design and implementation results. To estimate finger motion, the FFT processor should support at least 600~720-point operation for three-channel input data streams. Hence, we propose three-channel 729-point FFT processor based on the radix-3<SUP>2 </SUP>algorithm and a multipath delay commutator (MDC) pipeline architecture, which minimizes the number of nontrivial multiplications. Moreover, the FFT processor was designed using hardware description language (HDL) and synthesized to gate-level circuits using a standard cell library for 65 nm CMOS process. The proposed architecture results in a logic gate count of 219 K with die size of 0.81mm2 and required memory of 18 KB, which can be suitable for compact HGR radar, as it has a smaller area than similar processors.

목차

Abstract
I. INTRODUCTION
II. FFT FOR HGR
III. FFT PROCESSOR HARDWARE ARCHITECTURE
IV. DESIGN AND IMPLEMENTATION
V. CONCLUSIONS
REFERENCES

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