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저자정보
저널정보
한국지식정보기술학회 한국지식정보기술학회 논문지 한국지식정보기술학회 논문지 제13권 제3호
발행연도
2018.1
수록면
373 - 379 (7page)

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이 논문의 연구 히스토리 (14)

2018

3중 오류정정 BCH 부호의 저복잡도 복호기 설계
조용석 ,  신용달 한국지식정보기술학회 논문지 2018.01 학술저널

2017

CCSDS 위성통신 표준용 (255, 239) Reed Solomon 부호기 설계
조용석 한국지식정보기술학회 논문지 2017.01 학술저널

2011

UWB 시스템 용 Reed-Solomon 복호기 설계
조용석 한국통신학회논문지 2011.04 학술저널

1999

Reed-Solomon 부호의 직접복호법을 이용한 3중 오류정정 복호기 설계 ( Design of Triple-Error-Correcting Reed-Solomon Decoder using Direct Decoding Method )
조용석 ,  박상규 한국통신학회논문지 1999.08 학술저널

1998

( 47 , 41 ) Reed-Solomon 복호기 설계 ( Design of ( 47 , 41 ) Reed-Solomon Decoder )
조용석 ,  박상규 대한전자공학회 학술대회 1998.07 학술대회자료
(47, 41) Reed-Solomon 복호기 설계
조용석 ,  박상규 대한전자공학회 학술대회 1998.06 학술대회자료

1997

Reed-Solomon 부호의 오류위치 탐지회로 설계
조용석 ,  박상규 정보보호학회논문지 1997.12 학술저널
Reed-Solomon 부호의 오류위치 탐지법 ( On Error Location Search method for Reed-Solomon Codes )
조용석 ,  박상규 대한전자공학회 학술대회 1997.07 학술대회자료
Reed-Solomon 부호의 오류위치 탐지법
조용석 ,  박상규 대한전자공학회 학술대회 1997.06 학술대회자료

1991

표준기지 상의 직렬 Reed-Solomon 부호기 설계에 관한 연구
조용석 ,  욱창석 ,  임용배 한국통신학회 학술대회논문집 1991.08 학술대회자료

1988

(255, 223) RS부호의 직렬부호기
조용석 ,  이만영 한국통신학회논문지 1988.10 학술저널
직접복호법을 이용한 ( 225 , 239 ) BCH부호의 복호기 ( Hardware Implementation of ( 255 , 239 ) BCH Decoder Using Direct Decoding Method )
조용석 ,  박차생 ,  이만영 대한전자공학회 학술대회 1988.07 학술대회자료
직접복호법을 이용한 (255, 239) BCH 부호의 복호기
조용석 ,  박차생 ,  이만영 대한전기학회 학술대회 논문집 1988.07 학술대회자료

1987

Reed-Solomon 부호의 직렬부호기에 관한 연구 ( A Study on Bit-Serial Reed-Solomon Encoders )
조용석 ,  이만영 대한전자공학회 학술대회 1987.11 학술대회자료

초록· 키워드

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BCH 부호는 순회부호의 일종으로 강력한 다중오류정정 능력을 가지고 있다. 2진 BCH 부호는 강력한 오류정정 능력과 적당한 하드웨어 비용으로 인하여 데이터통신과 데이터 저장 시스템 등에 널리 사용되고 있다. 본 논문에서는 Peterson의 복호방법을 개선한 3중 오류정정 BCH 부호의 저복잡도 복호기 설계 방법을 제안한다. 제안된 복호기는 오류위치다항식을 계산하는데 있어서 유한체 GF(2^m) 상의 모든 나눗셈을 제거한 것이다. BCH 부호는 유한체 GF(2^m) 상에서 정의되며 모든 연산이 이 위에서 이루어진다. 유한체 GF(2^m) 상의 연산 중에서 가장 어렵고 복잡한 것이 나눗셈이며, BCH 부호의 종래의 복호 방법에서는 나눗셈이 필요하였다. 본 논문에서는 나눗셈이 생략된 3중 오류정정 BCH 부호의 복호기를 설계한다. 설계된 복호기는 LFSR과 논리 게이트들로 구현되는 오증 계산회로, 오류위치다항식 계산회로, 오류위치 탐지회로로 구성된다. 본 복호기는 매우 간단한 하드웨어로 구현할 수 있는 장점을 가지고 있다. 또한 제어회로도 매우 간단하고, 복호지연도 오증계산에 걸리는 한 블록만큼만 소요되므로 수신 시퀀스를 저장하는 버퍼 메모리를 절약할 수 있다.

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참고문헌 (15)

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Y. Lee / 2014 / Highthroughput and low-complexity BCH decoding architecture for solid-state drives / IEEE Transactions on Very Large Scale Integration Systems 22(5):1183~1187 google schola C. H. Yang / 2014 / A 5.4㎼ soft-decision BCH decoder for wireless body area networks / IEEE Trans-actions on Circuits and Systems, Regular Papers 61(9):2721~2729 google schola X. Zhang / 2012 / A low-complexity three-error-correcting BCH decoder for optical transport network / IEEE Transactions on Circuits and Systems II, Express Briefs 59(10):663~667 google schola Y. M. Lin / 2010 / A 26.9K 314.5 Mb/s soft (32400, 32208) BCH decoder chip for DVB-S2system / IEEE Journal of Solid-State Circuits 45(11):2330~2340 google schola M. Y. Rhee / 1989 / Error-correcting coding theory / McGraw-Hill google schola

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