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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2020.1
- 수록면
- 193 - 198 (6page)
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컨볼루셔널 뉴럴 네트워크 기술의 다양한 활용은 컴퓨팅 분야의 발전을 가속화하고 있으나, 이에 대한 반대급부로 심각한 하드웨어 성능 부족을 초래하고 있다. 그 대응책으로 뉴럴 네트워크 가속기, 차세대 메모리 소자 기술, 그리고 고대역폭 메모리 구조 등이 제안되었으나, 이들은 각각 범용성, 기술 성숙도, 그리고 높은 비용의 문제를 야기하여 적극적으로 도입되기 어려운 실정이다. 따라서 현재의 하드웨어 범용성을 그대로 유지하면서도 컨볼루셔널 뉴럴 네트워크 기술의 성능을 증대시킬 수 있는 방안이 필요하다. 본 연구는 메인메모리 내부에서 리프레쉬 동작이 수행되는 상황에서도 미리 저장된 XOR 비트 값을 사용하여 리프레쉬 동작의 종료 시점까지 대기하지 않아도 읽기 동작을 완료할 수 있는 DRAM 기반 메인메모리 기술을 제안한다. 실험 결과 제안 기법은 5.8%의 수행 속도 향상 및 1.2%의 에너지 절감, 그리고 10.6%의 EDP 향상을 보여주었다.
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참고문헌 (10)
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T. Ham / 2014 / Graphicionado: A High-Performance and Energy-Efficient Accelerator for Graph Analytics / MICRO 2014
Y. Wang / 2016 / Re-architecting the On-chip memory Sub-system of Machine-Learning Accelerator for Embedded Devices / ICCAD 2016
D. Xue / 2018 / Adaptive Memory Fusion: Towards Transparent, Agile Integration of Persistent Memory / HPCA 2018
Lee, Jong Chern / 2016 / High bandwidth memory (HBM) with TSV technique / 2016 International SoC Design Conference (ISOCC). IEEE
K. Chang / 2014 / Improving DRAM Performance by Parallelizing Refreshes with Accesses / HPCA 2014
Y. Wang / 2016 / Re-architecting the On-chip memory Sub-system of Machine-Learning Accelerator for Embedded Devices / ICCAD 2016
D. Xue / 2018 / Adaptive Memory Fusion: Towards Transparent, Agile Integration of Persistent Memory / HPCA 2018
Lee, Jong Chern / 2016 / High bandwidth memory (HBM) with TSV technique / 2016 International SoC Design Conference (ISOCC). IEEE
K. Chang / 2014 / Improving DRAM Performance by Parallelizing Refreshes with Accesses / HPCA 2014
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