AES 암호 엔진 기반 RFID Tag Core 설계

강민섭

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자료유형: 학술저널

저자정보: 강민섭 (안양대학교)

저널정보: 보안공학연구지원센터 보안공학연구논문지 보안공학연구논문지 제12권 제5호

발행연도: 2015.1

수록면: 487 - 500 (14page)

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본 논문에서는 RFID Tag의 보안성 향상을 위해 AES 암호 엔진을 사용한 RFID Tag Core의 하드웨어 설계를 제안한다. 제안한 RFID Tag Core는 Verilog HDL을 사용하여 Xilinx ISE 9.1i툴에서 설계하였으며, Xilinx XCV400E 디바이스를 타겟으로 합성을 수행하였다. 합성결과를 통하여 RFID Tag Core의 게이트 수는 약 14,504이며, 클럭 주파수는 72MHz로 동작함을 알 수 있다. 또한, AES 엔진의 게이트 수는 4,051이며, 48MHz로 동작함을 확인하였다. FPGA로 구현된 RFID Tag의 검증은 Model Sim 6.2c를 사용하였고, 시뮬레이션 결과를 통하여 설계된 시스템이 정확한 동작을 확인하였다.

#AES cipher engine #RFID Tag #Verilog HDL #FPGA

참고문헌 (10)

참고문헌 신청

2003 / ISO/IEC 18000-3. Information technology AIDC techniques—RFID for item management Air interface,—Part 3 / ISO/IEC 19762

B. C. Jeon / 2008 / Design of Robust RFID Authentication Protocol Using AES Cipher Processor / KIPS Fall Conf. 15(2):1473~1476

J. Daemen / AES Proposal: Rijndael, AES Algorithm Submission

M. Feldhofer / 2004 / Strong Authentication for RFID Systems Using the AES Algorithm / Proceedings of Cryptographic Hardware and Embedded Systems :35~370

Y. Zhang / 2010 / Pipelined implementation of AES encryption based on FPGA / 2010 IEEE International Conference on Information Theory and Information Security (ICITIS) :17~173

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