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논문 기본 정보

자료유형
학술저널
저자정보
조경주 (원광대학교)
저널정보
국제차세대융합기술학회 차세대융합기술학회논문지 차세대융합기술학회논문지 제6권 제2호
발행연도
2022.2
수록면
215 - 222 (8page)
DOI
https://doi.org/10.33097/JNCTA.2022.06.02.215

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이 논문의 연구 히스토리 (4)

2022

저오차 저면적 고정길이 Radix-8 Booth 곱셈기 설계
조경주 차세대융합기술학회논문지 2022.03 학술저널
고정길이 복소곱셈기를 이용한 FFT 설계에 관한 연구
조경주 차세대융합기술학회논문지 2022.02 학술저널

2008

고정계수 곱셈을 위한 비트패턴 전용덧셈기 설계
조경주 ,  김용은 한국정보통신학회논문지 2008.11 학술저널

2005

비트패턴 전용덧셈기를 이용한 고정계수 곱셈기의 디자인
조경주 ,  김용은 ,  정진균 대한전자공학회 학술대회 2005.05 학술대회자료

초록· 키워드

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본 논문에서는 FFT의 연산 복잡도를 줄이기 위해 효율적인 고정길이 복소곱셈기의 설계 방법과 구조를 제안하고, 이를 이용하여 파이프라인 FFT를 효율적으로 설계하는 방법을 제안한다. 확률적 통계에 기반한 오차보 상을 통해 고정길이 Booth 곱셈기의 설계 방법을 제안하고, 이를 이용하여 고정길이 복소곱셈기의 구조를 제안한 다. 기존 오차보상 방법와 비교하여 제안한 방법의 오차성능이 우수하며, 기존 복소곱셈기 보다 제안한 복소곱셈 기가 하드웨어를 약 36% 적게 사용하였다. 또한, 1024 포인트 FFT의 SQNR(Signal to Quantization Noise Ratio) 시뮬레이션에서 기존 복소곱셈기를 적용한 방법 보다 제안한 고정길이 복소곱셈기를 적용한 방법의 SQNR 이 우수하게 나타났다. 1024 포인트 SDF FFT를 설계한 후 FPGA로 합성한 결과, 기존 복소곱셈기를 적용한 설 계 보다 제안한 복소곱셈기를 적용한 설계가 하드웨어를 약 27% 적게 사용하였다.
#고속 퓨리어 변환 # 연산 복잡도 # 고정길이 # 복소곱셈기 # 오차보상 #FFT # Computational complexity # Fixed-width # Complex multiplier # Error compensation

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