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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 한국과학기술원 정보전자연구소 IDEC Journal of Integrated Circuits and Systems IDEC Journal of Integrated Circuits and Systems Vol.3 No.2
- 발행연도
- 2017.4
- 수록면
- 36 - 43 (8page)
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The high-efficiency NFC AFE(Analog Front-End) was proposed and implemented in 65nm CMOS process. We proposed the novelty architecture of Envelope Detector which is the most important block in passive mode tag because those generate their own power. The Envelope Detector generating negative voltage and it can generate the negative voltage of -0.68V that is used for body bias and can detect the small voltage swing of 0.5V. The area of the high-efficiency NFD AFE is 1.9mmx2mm and it is very small compared with the conventional NFC AFE. The digital part of NFC is also verified by FPGA board. So the proposed NFC tag is feasible for many applications.
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Yan Lu / 2013 / A 13.56MHz Fully Integrated 1X/2X Active Rectifier with Compensated Bias Current for Inductively Powered Devices / IEEE, Solid-State Circuits Conference Digest of Technical Papers(ISSCC) :66~67
Jong-Wook Lee / 2014 / A Fully Integrated EPC Gen-2 UHF-Band Passive Tag IC Using an Efficient Power Management Technique / IEEE Transactions on Industrial Electronics 61(6):2922~2932
Jung-Hyun Cho / 2009 / An NFC transceiver using an inductive powered receiver for passive, active, RW and RFID modes / IEEE, International SoC Design Conference (ISOCC) :456~459
조정현 / 2007 / 단일 칩 NFC 트랜시버의 설계 / 전자공학회논문지 - SD 44(1):68~75
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